手把手教你學CPLD/FPGA與單片機聯合設計

定　價：￥39.00

作　者：	周興華，李玉麗，傅飛峰編著
出版社：	北京航空航天大學出版社
叢編項：
標　簽：	維修

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ISBN：	9787512402447	出版時間：	2010-11-01	包裝：	平裝
開本：	16開	頁數：	293	字數：

內容簡介

　　作者從2009年1月起，在《電子世界》雜志上連載了《手把手教你學CPLD／FPGA設計》講座?！妒职咽纸棠銓WCPLD/FPGA與單片機聯合設計（附光盤1張）》以此為藍本，另外增加了大量的篇幅與實驗例子進行充實。此外，為了幫助讀者掌握單片機與CPLD／FPGA的聯合設計，還介紹了51單片機的基本知識及單片機c語言編程的基礎知識，并通過實例設計進行詳解?！妒职咽纸棠銓WCPLD/FPGA與單片機聯合設計（附光盤1張）》以實踐（實驗）為主線，以生動短小的實例為靈魂，穿插介紹了Verilog HDL語言的語法及Altera公司的EPM7128S（或Atmel公司的ATFl508A5）設計開發(fā)編程?！妒职咽纸棠銓WCPLD/FPGA與單片機聯合設計（附光盤1張）》理論與實踐緊密結合，由淺入深、循序漸進地引導讀者進行學習、實驗，這樣讀者學得進、記得牢，不會產生畏難情緒，無形之中就掌握了CPLD／FPGA的聯合設計。《手把手教你學CPLD/FPGA與單片機聯合設計（附光盤1張）》貫徹《手把手教你學系列叢書》的教學方式。書中附有光盤，含《手把手教你學CPLD/FPGA與單片機聯合設計（附光盤1張）》所有的程序設計文件?！妒职咽纸棠銓WCPLD/FPGA與單片機聯合設計（附光盤1張）》可用作大學本科或?？?、中高等職業(yè)技術學校、電視大學等的教學用書，也可作為CPLD／FPGA愛好者的自學用書。

作者簡介

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圖書目錄

第1章可編程邏輯器件概述
1.1 可編程邏輯器件簡介
1.1.1 可編程邏輯器件的基本結構
1.1.2 可編程邏輯器件的分類及特點
1.1.3 可編程邏輯器件的邏輯表示方法
1.2 CPLD／FPGA的結構與特性
1.2.1 基于乘積項的CPLD原理與結構
1.2.2 基于乘積項的CPLD邏輯實現方式
1.2.3 基于查找表的FPGA原理與結構
1.2.4 基于查找表的FPGA邏輯實現方式
1.2.5 CPLD與FPGA器件的差別
1.3 Altera公司的MAX7000系列（2PLD特性介紹
1.3.1 邏輯陣列塊（LAB）
1.3.2 宏單元
1.3.3 擴展乘積項
1.3.4 可編程連線陣列
1.3.5 I／O控制塊
1.3.6 其他特性
第2章可編程邏輯器件的設計流程及學習開發(fā)器材
2.1 可編程邏輯器件的設計流程
2.1.1 設計輸入
2.1.2 綜合
2.1.3 CPLD／FPGA器件適配
2.1.4 仿真
2.1.5 編程下載
2.2 CPLD／FPGA與單片機聯合設計的學習器材介紹
2.2.1 Altera公司的集成開發(fā)軟件MAX+plusII及QuartusII
2.2.2 KeiIC51Windows集成開發(fā)環(huán)境
2.2.3 MCU&CPLDDEMO綜合試驗板
2.2.4 ByteBlasterMV并口下載器
2.2.5 單片機USB程序下載器
2.2.6 9V高穩(wěn)定專用穩(wěn)壓電源
第3章開發(fā)軟件的安裝
3.1 KeilC51集成開發(fā)軟件安裝
3.2 MAX+plusⅡ集成開發(fā)軟件安裝
3.3 QuartusⅡ集成開發(fā)軟件安裝
3.4 USBasp下載器的安裝與使用
3.4.1 USBasp下載器的安裝
3.4.2 USBasp下載器的使用
3.5 Atmel并口下載軟件atmelisp的安裝
3.6 POF to JED轉換軟件Pof2jed的安裝
第4章第一個CPLD／FPGA入門實驗程序
4.1 使用Max+plusⅡ集成開發(fā)軟件進行入門實驗
4.1.1 建立項目
4.1.2 設計輸入（原理圖或硬件描述語言）
4.1.3 選擇器件并鎖定引腳
4.1.4 編譯器件
4.1.5 仿真
4.1.6 編程下載
4.1.7 應用
4.2 使用QuartusⅡ集成開發(fā)軟件進行入門實驗
4.2.1 建立項目
4.2.2 設計輸入（原理圖或硬件描述語言）
4.2.3 設計編譯
4.2.4 仿真
4.2.5 引腳分配
4.2.6 編程下載
4.2.7 立用
第5章 VerilogHDL硬件描述語言
5.1 VerilogHDL模塊的基本結構
5.1.1 模塊聲明
5.1.2 端口定義
5.1.3 信號類型說明
5.1.4 邏輯功能描述
5.1.5 實驗程序1——緩沖器
5.1.6 實驗程序2——反相器（非門）
5.2 VerilogHDL語法要素
5.2.1 標識符與關鍵字
5.2.2 常量、變量及數據類型
5.2.3 實驗程序3——與門
5.2.4 實驗程序4——與非門
5.2.5 實驗程序5——LED的閃爍
5.2.6 運算符
5.2.7 運算符的優(yōu)先級
5.2.8 實驗程序6——或門
5.2.9 實驗程序7——或非門
5.2.1 0實驗程序8——異或門
5.2.1 1實驗程序9——異或非門
5.2.1 2實驗程序10——三態(tài)門
5.3 VerilogHDL的行為語句
5.3.1 賦值語句
5.3.2 過程語句
5.3.3 塊語句
5.3.4 條件語句
5.3.5 循環(huán)語句
5.3.6 編譯預處理
5.3.7 任務和函數
5.4 VerilogHDL數字邏輯單元結構的設計
5.4.1 結構描述方式
5.4.2 實驗程序——門級結構描述設計的基本門電路
5.4.3 數據流描述方式
5.4.4 行為描述方式
第6章組合邏輯電路的設計實驗
6.1 2選1數據選擇器
6.1.1 2選1數據選擇器簡介
6.1.2 采用數據流描述方式的設計
6.1.3 采用行為描述方式的設計
6.2 4選1數據選擇器
6.2.1 4選1數據選擇器簡介
6.2.2 采用數據流描述方式的設計
6.2.3 采用行為描述方式的設計
6.3 3位二進制優(yōu)先編碼器（8-3優(yōu)先編碼器）
6.3.1 3位二進制優(yōu)先編碼器簡介
6.3.2 3位二進制優(yōu)先編碼器的設計
6.4 3位二進制譯碼器（3-8譯碼器）
6.4.1 3位二進制譯碼器簡介
6.4.2 3位二進制譯碼器的設計
6.5 BCD-7段譯碼器
6.5.1 BCD-7段譯碼器簡介
6.5.2 BCD-7段譯碼器的設計
6.6 半加器
6.6.1 半加器簡介
6.6.2 采用門級描述方式的半加器設計
6.6.3 采用數據流描述方式的半加器設計
6.6.4 采用行為描述方式的半加器設計
6.7 全加器
6.7.1 全加器簡介
6.7.2 全加器的設計
第7章觸發(fā)器的設計實驗
7.1 RS觸發(fā)器
7.1.1 RS觸發(fā)器簡介
7.1.2 RS觸發(fā)器的設計
7.2 JK觸發(fā)器
7.2.1 JK觸發(fā)器簡介
7.2.2 JK觸發(fā)器的設計
7.3 帶有復位的JK觸發(fā)器
7.3.1 帶有復位的JK觸發(fā)器簡介
7.3.2 帶有復位的JK觸發(fā)器的設計
7.4 D觸發(fā)器
7.4.1 D觸發(fā)器簡介
7.4.2 D觸發(fā)器的設計
7.5 帶有復位的D觸發(fā)器
7.5.1 帶有復位的D觸發(fā)器簡介
7.5.2 帶有復位的D觸發(fā)器的設計
7.6 帶有復位的異步T觸發(fā)器
7.6.1 帶有復位的異步T觸發(fā)器簡介
7.6.2 帶有復位的異步T觸發(fā)器的設計
7.7 帶有復位的同步T觸發(fā)器
7.7.1 帶有復位的同步T觸發(fā)器簡介
7.7.2 帶有復位的同步T觸發(fā)器的設計
第8章時序邏輯電路的設計實驗
8.1 寄存器
8.1.1 寄存器簡介
8.1.2 寄存器的設計
8.2 鎖存器
8.2.1 鎖存器簡介
8.2.2 鎖存器的設計
8.3 移位寄存器
8.3.1 移位寄存器簡介
……
第9章 CPLD/FPGA的設計應用
第10章 51單片機的基本知識
第11章單片機C語言基礎知識
第12章 CPLD/FPGA與單片機的接口及數據傳輸
第13章 CPLD/FPGA與單片機的聯合設計實例——液晶顯示頻率計
參考文獻